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74HC373D,653

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( 단위:원 )
1~99
100~499
500~999
1000이상
Box당단가
Box당수량
200
160
150
140
130
2,000
RoHS : -
재고수량 : 76,018
적용분야 : COMMON STB
수량선택 : 개 X 원 =
상담문의 TEL. 1588-9809(대표), 02) 3397-3613
 
 
 
* Octal D-type transparent latch; 3-state


* General description


The 74HC373; 74HCT373 is a high-speed Si-gate CMOS device and is pin compatible
with Low-power Schottky TTL. It is specified in compliance with JEDEC standard no. 7A.
The 74HC373; 74HCT373 is an octal D-type transparent latch featuring separate D-type
inputs for each latch and 3-state outputs for bus oriented applications. A latch enable (LE)
input and an output enable (OE) input are common to all latches.
The 74HC373; HCT373 consists of eight D-type transparent latches with 3-state true
outputs. When LE is HIGH, data at the Dn inputs enters the latches. In this condition the
latches are transparent, i.e. a latch output will change state each time its corresponding
D input changes.
When LE is LOW the latches store the information that was present at the D inputs a
set-up time preceding the HIGH-to-LOW transition of LE. When OE is LOW, the contents
of the 8 latches are available at the outputs. When OE is HIGH, the outputs go to the highimpedance
OFF-state. Operation of the OE input does not affect the state of the latches.
The 74HC373; 74HCT373 is functionally identical to:
• 74HC533; 74HCT533: but inverted outputs
• 74HC563; 74HCT563: but inverted outputs and different pin arrangement
• 74HC573; 74HCT573: but different pin arrangement


* Features

3-state non-inverting outputs for bus oriented applications
Common 3-state output enable input
Functionally identical to the 74HC563; 74HCT563, 74HC573; 74HCT573 and 74HC533; 74HCT533
ESD protection:
   - HBM EIA/JESD22-A114-C exceeds 2 000 V
   - MM EIA/JESD22-A115-A exceeds 200 V
Specified from -40 °C to +85 °C and from -40 °C to +125 °C
 
 
 
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